제품 세부 정보

집 제품

SOI Wafer:Lower parasitic capacitance stronger latch-up immunity improved radiation resistance

브랜드 이름:	ZMSH
모델 번호:	소이웨이퍼
MOQ:	25
가격:	Fluctuates with market
배달 시간:	2~4주
지불 조건:	티/티

자세한 정보

제품 설명

자세한 정보

원래 장소:

중국 상하이

재료:

이산화규소(SiO2)/실리콘(Si)

웨이퍼 지름:

맞춤형

장치 레이어 두께:

맞춤형

BOX 층 두께:

맞춤형

결정 방향:

<100> / <110> / <111> / 맞춤형

도전성 타입:

N형 / P형 / 맞춤형

제품 설명

Product Information SOI (Silicon-on-Insulator) is a “sandwich” structure wafer consisting of three layers: the top silicon layer, also known as the Top Si / Device Layer, is used to fabricate transistors; the middle layer is the Buried Oxide (BOX), which provides electrical isolation; and the bottom layer is the silicon support substrate (Handle/Substrate Wafer). Compared with conventional Bulk Si wafers, SOI wafers feature complete dielectric isolation, enabling lower

태그:

닦은 실리콘 박편

실리콘 기판

반도체 웨이퍼

MEMS, 센서 및 반도체 응용 분야용 구리 도금 단결정 실리콘 웨이퍼

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4인치 N형 P 도핑된 Si (100) with 100 nm Ti + 200 nm Cu 박막 Cu 필름 on Ti/실리콘 웨이퍼

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사파이어 웨이퍼

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IC 실리콘 박편

와이어 톱 머신

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사파이어 부속

합성 원석

반도체 장비

LiNbO3 웨이퍼

인듐 인화물 웨이퍼

세라믹 기질

실험실 래퍼

갈륨 질화물 웨이퍼

갈륨 비소 웨이퍼

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SOI Wafer:Lower parasitic capacitance stronger latch-up immunity improved radiation resistance

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